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Verilog 下实现开关电源PWM调节

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发表于 2018-11-4 17:54:35 | 显示全部楼层 |阅读模式
在开关电源设计中,PWM调节是至关重要的一种调节方式,类似的还有PFM,PSM等,今天学习的是在Verilog下实现PWM波形输出。网上也有很多相关代码,今天分享的是对称性的,程序如下,大家相互交流。
always@(posedge clk)
                begin: Triangle_wave
                                case(Count_direction)
                                        Increase_count:
                                                begin
                                                        counter<=counter+1'b1;
                                                        if(counter==PWM_PRD)
                                                                Count_direction<=0;
                                                        else
                                                                Count_direction<=1;
                                                end
                                        Decrease_count:
                                                begin
                                                        counter<=counter-1'b1;
                                                        if(counter==0)
                                                                Count_direction<=1;
                                                        else
                                                                Count_direction<=0;
                                                end
                                        default:counter<=0;                                               
                                endcase
                end               
               
       
        always@(posedge clk)
                begin
                        if(counter<=PWM_CMP)
                                PWM_OUT<=1;
                        else
                                PWM_OUT<=0;       
                end

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发表于 2018-11-5 10:59:05 | 显示全部楼层
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